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2入力ANDゲート
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2入力NANDゲート
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2入力排他的ORゲート
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3入力AND-OR複合ゲート
3入力OR-AND複合ゲート
3 入力 多数決回路
3ステート 8ビット幅 バスバッファ Aタイプ
3ステート 8ビット幅 バスバッファ Bタイプ
3ステート 8ビット幅 バスバッファ Cタイプ
1ビット 片方向 ハイインピーダンス機能付き出力バッファ
1ビット 片方向 ハイインピーダンス機能付き入出力バッファ
1ビット 双方向 ハイインピーダンス機能付き入出力バッファ
1ビット 非同期式リセット・フリップフロップ
1ビット 同期式リセット・フリップフロップ
4ビット 非同期式リセット・レジスタ(多ビットバスサンプル)
4ビット 同期式リセット・レジスタ(多ビットバスサンプル)
4ビットバイナリカウンタ
8ビットバイナリカウンタ(4ビットカウンタx2個内包形式)
8ビット パリティ生成
16ビット パリティ生成
32ビット パリティ生成
4ビット クロック同期式加算器
4ビット 組合わせ回路方式加算器
8ワードx8ビット幅 PROM
8ワード x 8ビット幅 SRAM(メモリアレイ)
15ワード x 8ビット幅 同期式 FIFO
FUNC{}構文使用 階層構造型4ビット組合わせ回路方式加算器
SEQ{}構文使用 4×4乗算器
IF()構文使用例
中級
同期調歩式シリアル通信回路 受信側
同期調歩式シリアル通信回路 送信側
機能編
NSLチュートリアル
0.NSLの基本要領
1.入出力構成要素
2.内部端子・レジスタ
3.アクション記述
4.制御端子
5.サブモジュール
6.プロシージャ
7.状態変数
8.メモリ
9.インターフェース
10.システムタスク
11.ディレクティブ
12.構造体
13.NSL Core オプション一覧
ダウンロード
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機能編
機能ごとに分けたNSLのサンプル回路(IPコア)の一覧です。無償でダウンロード、閲覧、ご利用いただけます。
カテゴリ
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機能解説
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周辺I/O機能
誤り検出(チェックサム)回路
CRC16
誤り検出符号としての16ビットデータ長・巡回冗長検査回路モジュールです。生成多項式はCRC-16-CCITTで規定されている0×1021をデフォルトの値として設定していますが、NSLソースコード内のパラメータ宣言部を変更することで他の生成多項式を使用できます。
周辺I/O機能
誤り検出(チェックサム)回路
CRC32
誤り検出符号としての32ビットデータ長・巡回冗長検査回路モジュールです。生成多項式はCRC-32-IEEE 802.3で規定されている0×04C11DB7をデフォルトの値として設定していますが、NSLソースコード内のパラメータ宣言部を変更することで他の生成多項式を使用できます。
マルチメディア系
Video / Image
YUV -> RGB
CCIR-601.1に基づくYUV信号(8ビットフルスケール)からRGB-8/8/8画素情報を生成します。
マルチメディア系
Video / Image
RGB -> YUV
CCIR-601.1に基づくRGB-8/8/8画素情報からYUV信号(8ビットフルスケール)を生成します。
マルチメディア系
Video / Image
YCbCr -> RGB
CCIR-601.1に基づくYCbCr信号(8ビットフルスケール)からRGB-8/8/8画素情報を生成します。
マルチメディア系
Video / Image
RGB -> YCbCr
CCIR-601.1に基づくRGB-8/8/8画素情報からYCbCr信号(8ビットフルスケール)を生成します。
数値演算処理
浮動小数点演算
加算器-1 (リファレンスデザイン)
32ビット単精度の浮動小数点演算回路サンプルです。サイクルベースの加算器で、フォーマットはIEEE 754の単精度ベースです。ライセンスのないNSL Coreの500行制限でも合成できるよう、ソースを分割してあります。また、浮動小数点演算の動作理解をするために作られたソースコードですので、シミュレーションモデルは同封されていません。
数値演算処理
浮動小数点演算
減算器-1 (リファレンスデザイン)
32ビット単精度の浮動小数点演算回路サンプルです。サイクルベースの加算器で、フォーマットはIEEE 754の単精度ベースです。ライセンスのないNSL Coreの500行制限でも合成できるよう、ソースを分割してあります。また、浮動小数点演算の動作理解をするために作られたソースコードですので、シミュレーションモデルは同封されていません。
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